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| 型号 | 功能描述 | 生产厂家 企业 | LOGO | 操作 |
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ICS874S02I | One differential clock input pair 文件：4.08865 Mbytes Page：16 Pages | IDT |   | |
丝印代码：ICS874S02BMILF；1:1 Differential-to-LVDS Zero Delay Clock Generator Features • One differential LVDS output pair and one differential feedback output pair • One differential clock input pair • CLK/nCLK can accept the following differential input levels: LVPECL, LVDS, LVHSTL, SSTL • Input frequency range: 62.5MHz to 1GHz • Output frequency range: 62.5MHz to | RENESAS 瑞萨 | | ||
1:1 Differential-to-LVDS Zero Delay Clock Generator 文件：401.42 Kbytes Page：17 Pages | IDT | | ||
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1:1 Differential-to-LVDS Zero Delay Clock Generator 文件：401.42 Kbytes Page：17 Pages | IDT | |
| IC供应商 | 芯片型号 | 品牌 | 批号 | 封装 | 库存 | 备注 | 价格 |
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2020-2-26
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