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87004AGLF

1:4,Differential-to-LVCMOS/LVT

Features •FourLVCMOS/LVTTLoutputs,7Ωtypicaloutputimpedance •SelectableCLK0/nCLK0orCLK1/nCLK1clockinputs •CLKx/nCLKxpairscanacceptthefollowingdifferential inputlevels:LVPECL,LVDS,LVHSTL,HCSL,SSTL •InternalbiasonnCLK0andnCLK1tosupportLVCMOS/LVTTL levelsonCL

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瑞萨瑞萨科技有限公司

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87004AGLF

封装/外壳:24-TSSOP(0.173",4.40mm 宽) 包装:卷带(TR) 描述:IC CLK GENERATOR ZD 1:4 24-TSSOP 集成电路(IC) 时钟发生器,PLL,频率合成器

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CustomerSpecification

Construction 1)Component14X1COND a)Conductor24(7/32)AWGBareCopper0.024 b)Insulation0.016Wall,Nom.TPES(Hytrel)0.056 (1)Print ALPHANUMERICNUMBERS-1-ONEALTERNATINGAND INVERTED (2)ColorCodeAlphaWireColorCodeKX CondColorCondColorCondColor 1 GREEN/YELL

ALPHAWIREAlpha Wire

阿尔法电线

ALPHAWIRE

1:4,Differential-to-LVCMOS/LVT

Features •FourLVCMOS/LVTTLoutputs,7Ωtypicaloutputimpedance •SelectableCLK0/nCLK0orCLK1/nCLK1clockinputs •CLKx/nCLKxpairscanacceptthefollowingdifferential inputlevels:LVPECL,LVDS,LVHSTL,HCSL,SSTL •InternalbiasonnCLK0andnCLK1tosupportLVCMOS/LVTTL levelsonCL

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封装/外壳:24-TSSOP(0.173",4.40mm 宽) 包装:卷带(TR) 描述:IC CLOCK GEN ZD 1:4 24-TSSOP 集成电路(IC) 时钟发生器,PLL,频率合成器

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1:4,Differential-to-LVCMOS/LVT

Features •FourLVCMOS/LVTTLoutputs,7Ωtypicaloutputimpedance •SelectableCLK0/nCLK0orCLK1/nCLK1clockinputs •CLKx/nCLKxpairscanacceptthefollowingdifferential inputlevels:LVPECL,LVDS,LVHSTL,HCSL,SSTL •InternalbiasonnCLK0andnCLK1tosupportLVCMOS/LVTTL levelsonCL

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1:4,Differential-to-LVCMOS/LVT

Features •FourLVCMOS/LVTTLoutputs,7Ωtypicaloutputimpedance •SelectableCLK0/nCLK0orCLK1/nCLK1clockinputs •CLKx/nCLKxpairscanacceptthefollowingdifferential inputlevels:LVPECL,LVDS,LVHSTL,HCSL,SSTL •InternalbiasonnCLK0andnCLK1tosupportLVCMOS/LVTTL levelsonCL

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更新时间:2024-6-12 18:32:00
IC供应商 芯片型号 品牌 批号 封装 库存 备注 价格
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原装现货

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