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28-BIT 1:2 REGISTERED BUFFER WITH PARITY

FEATURES: • 1.8V Operation • SSTL_18 style clock and data inputs • Differential CLK input • Control inputs compatible with LVCMOS levels • Flow-through architecture for optimum PCB design • Latch-up performance exceeds 100mA • ESD >2000V per MIL-STD-883, Method 3015; >200V using machine mo

RENESAS

瑞萨

更新时间:2025-12-26 11:41:01
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