| 型号 | 功能描述 | 生产厂家 企业 | LOGO | 操作 |
|---|---|---|---|---|
Low Skew Output Buffer DESCRIPTION The PLL102-10 is a high performance, low skew, low jitter zero delay buffer designed to distribute high speed clocks and is available in 8-pin SOIC or MSOP package. It has two outputs that are synchronized with the input. The synchronization is established via CLKOUT feed back to the | PLL |   | ||
UNIVERSAL INPUT AC-DC OPEN FRAME SINGLE & MULTI-OUTPUT 100 WATTS INTERNAL SWITCHING POWER SUPPLIES 文件：361.06 Kbytes Page：2 Pages | HITRON 仲琦科技 | | ||
Low Skew Output Buffer 文件：287.78 Kbytes Page：7 Pages | Micrel 麦瑞半导体 | | ||
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更新时间：2025-10-19 23:32:01
| IC供应商 | 芯片型号 | 品牌 | 批号 | 封装 | 库存 | 备注 | 价格 |
|---|---|---|---|---|---|---|---|
恩XP |
24+ |
TEPBGA-689 |
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恩XP |
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TEPBGA-689 |
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