| 型号 | 功能描述 | 生产厂家 企业 | LOGO | 操作 |
|---|---|---|---|---|
Low Skew, 1-to-16 Differential-to- LVDS, Clock Distribution Chip FEATURES • Sixteen Differential LVDS outputs • CLK, nCLK pair can accept the following differential input levels: LVPECL, LVDS, LVHSTL, HCSL, SSTL • Maximum output frequency: 700MHz • Translates any differential input signal (LVPECL, LVHSTL, SSTL, DCM) to LVDS levels without external bias ne | RENESAS 瑞萨 |   | ||
T1/E1 Interface Modules 文件：176.78 Kbytes Page：1 Pages | FILTRAN 费尔兰特 | | ||
Heyco-Flex™ Quick Twist Conduit Fittings 文件：136.68 Kbytes Page：1 Pages | Heyco | | ||
Low Skew, 1-to-16 Differential-to-LVDS, Clock Distribution Chip 文件：181.32 Kbytes Page：18 Pages | IDT | | ||
Low Skew, 1-to-16 Differential-to-LVDS, Clock Distribution Chip 文件：181.32 Kbytes Page：18 Pages | IDT | |
| IC供应商 | 芯片型号 | 品牌 | 批号 | 封装 | 库存 | 备注 | 价格 |
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NA/ |
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2020-12-11
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