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| 型号 | 功能描述 | 生产厂家 企业 | LOGO | 操作 |
|---|---|---|---|---|
SY100EL34LZI-TR | 封装/外壳：16-SOIC（0.154"，3.90mm 宽） 包装：管件 描述：IC CLK GEN /2/4/6 5V/3.3V 16SOIC 集成电路（IC） 时钟发生器，PLL，频率合成器 | Microchip 微芯科技 |   | |
첨2,첨4,첨8 Clock Generation Chip Description The MC10/100EL34 is a low skew ÷2, ÷4, ÷8 clock generation chip designed explicitly for low skew clock generation applications. Features • 50 ps Output-to-Output Skew • Synchronous Enable/Disable • Master Reset for Synchronization • PECL Mode Operating Range: VCC = 4.2 | ONSEMI 安森美半导体 | | ||
5V ECL 첨2, 첨4, 첨8 Clock Generation Chip Description The MC10/100EL34 is a low skew ÷2, ÷4, ÷8 clock generation chip designed explicitly for low skew clock generation applications. Features • 50 ps Output-to-Output Skew • Synchronous Enable/Disable • Master Reset for Synchronization • PECL Mode Operating Range: VCC = 4.2 | ONSEMI 安森美半导体 | | ||
첨2,첨4,첨8 Clock Generation Chip Description The MC10/100EL34 is a low skew ÷2, ÷4, ÷8 clock generation chip designed explicitly for low skew clock generation applications. Features • 50 ps Output-to-Output Skew • Synchronous Enable/Disable • Master Reset for Synchronization • PECL Mode Operating Range: VCC = 4.2 | ONSEMI 安森美半导体 | | ||
5V ECL 첨2, 첨4, 첨8 Clock Generation Chip 文件：133.17 Kbytes Page：8 Pages | ONSEMI 安森美半导体 | | ||
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| IC供应商 | 芯片型号 | 品牌 | 批号 | 封装 | 库存 | 备注 | 价格 |
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SY100EP195VTG-TR
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2023-2-24SXT11410FE48-25.000MT
优势渠道
2022-12-26SY100ELT23ZGTR 原装现货
SY100ELT23ZGTR 可做含税，支持实单
2021-9-17SXH-001T-P0.6
属性 参数值 商品目录 压接端子 触头材料 磷青铜 触头镀层 锡 线规 - AWG 22~28 镀层厚度 - 线规 - mm2 0.08~0.33 产品类型 压线端子 认证 UL ， RoHS ， CSA ， TUV
2020-11-13SY100S363JZTR 编码器、解码器、复用器和解复用器
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2020-1-31
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