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144-MbitDDRIISRAMTwo-WordBurstArchitecture(2.0CycleReadLatency)

FunctionalDescription TheCY7C1648KV18,andCY7C1650KV18are1.8-VsynchronouspipelinedSRAMsequippedwithDDRII+architecture.TheDDRII+consistsofanSRAMcorewithadvancedsynchronousperipheralcircuitry. Features ■144-Mbitdensity(8M×18,4M×36) ■450-MHzclockforhighban

CypressCypressSemiconductor

赛普拉斯赛普拉斯半导体公司

Cypress

144-MbitDDRIISRAMTwo-WordBurstArchitecture(2.0CycleReadLatency)

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Cypress
更新时间:2025-6-27 11:48:01
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