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72125L25TPG8

CMOS PARALLEL-TO-SERIAL FIFO 1,024 x 16

• 25ns parallel port access time, 35ns cycle time • 50MHz serial shift frequency • Wide x16 organization offering easy expansion • Low power consumption (50mA typical) • Least/Most Significant Bit first read selected by asserting the FL/DIR pin • Four memory status flags: Empty, Full, Half-F

RENESAS

瑞萨

72125L25TPG8

CMOS PARALLEL-TO-SERIAL FIFO

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IDT

更新时间:2026-1-28 15:13:00
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