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| 型号 | 功能描述 | 生产厂家 企业 | LOGO | 操作 |
|---|---|---|---|---|
UR5596-S08-R | MOS IC DESCRIPTION The UTC UR5596 is a linear bus termination regulator and designed to meet JEDEC SSTL-2(Stub-Series Terminated Logic) specifications for termination of DDR-SDRAM. It also can be used in SSTL-3 or HSTL (High-Speed Transceiver Logic) scheme. The device contains a high-speed OP AMP to pro | UTC 友顺 |   | |
UR5596-S08-R | DDR TERMINATION REGULATOR 文件：219.14 Kbytes Page：12 Pages | UTC 友顺 | | |
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UR5596-S08-R | DDR TERMINATION REGULATOR 文件：218.33 Kbytes Page：12 Pages | ETL 亚历电子 | | |
DDR TERMINATION REGULATOR 文件：223.86 Kbytes Page：12 Pages | UTC 友顺 | |
UR5596-S08-R产品属性
- 类型
描述
- 型号
UR5596-S08-R
- 制造商
UTC-IC
- 制造商全称
UTC-IC
- 功能描述
DDR TERMINATION REGULATOR
| IC供应商 | 芯片型号 | 品牌 | 批号 | 封装 | 库存 | 备注 | 价格 |
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