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| 型号 | 功能描述 | 生产厂家 企业 | LOGO | 操作 |
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SN54LS113AW | DUAL J-K NEGATIVE-EDGE-TRIGGERED FLIP-FLOPS WITH PRESET 文件：259.97 Kbytes Page：6 Pages | TI 德州仪器 |   | |
DUAL JK NEGATIVE EDGE-TRIGGERED FLIP-FLOP DUAL JK NEGATIVE EDGE-TRIGGERED FLIP-FLOP The SN54 /74LS113A offers individual J, K, set, and clock inputs. These monolithic dual flip-flops are designed so that when the clock goes HIGH, the inputs are enabled and data will be accepted. The logic level of the J and K inputs may be allowed to cha | Motorola 摩托罗拉 | | ||
Dual JK Edge-Triggered Flip-Flop 文件：98.04 Kbytes Page：6 Pages | NSCNational Semiconductor (TI) 美国国家半导体美国国家半导体公司 | | ||
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| IC供应商 | 芯片型号 | 品牌 | 批号 | 封装 | 库存 | 备注 | 价格 |
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TI |
23+ |
CDIP |
3200 |
正规渠道,只有原装! |
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TI |
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CDIP |
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TI |
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原装正品现货 |
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TI |
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TI/德州仪器 |
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CDIP |
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CDIP |
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SN54LS113AW规格书下载地址
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