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P2V28S20DTP-7

128Mb SDRAM Specification

DESCRIPTION P2V28S20ATP is organized as 4-bank x 8,388,608-word x 4-bit Synchronous DRAM with LVTTL interface and P2V28S30ATP is organized as 4-bank x 4,194,304-word x 8-bit and P2V28S40ATP is organized as 4-bank x 2,097, 152-word x 16-bit. All inputs and outputs are referenced to the rising edge

VML

世界先进

P2V28S20DTP-7产品属性

  • 类型

    描述

  • 型号

    P2V28S20DTP-7

  • 制造商

    VML

  • 制造商全称

    VML

  • 功能描述

    128Mb SDRAM Specification

更新时间:2026-1-2 11:12:00
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