型号 功能描述 生产厂家 企业 LOGO 操作
P102-05SCL

Low Skew Output Buffer

DESCRIPTION The PLL102-05 is a high performance, low skew, low jitter zero delay buffer designed to distribute high speed clocks and is available in 8-pin SOIC package. It has four outputs that are synchronized with the input. The synchronization is established via CLKOUT feed back to the input o

PLL

LF (125 kHz)

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BALLUFF

巴鲁夫

LF (125 kHz)

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BALLUFF

巴鲁夫

LF (125 kHz)

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BALLUFF

巴鲁夫

LF (125 kHz)

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BALLUFF

巴鲁夫

UHF (860...960 MHz)

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BALLUFF

巴鲁夫

P102-05SCL产品属性

  • 类型

    描述

  • 型号

    P102-05SCL

  • 制造商

    PLL

  • 制造商全称

    PLL

  • 功能描述

    Low Skew Output Buffer

更新时间:2026-3-1 19:00:00
IC供应商 芯片型号 品牌 批号 封装 库存 备注 价格
恩XP
24+
TEPBGA-689
6982
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TEPBGAII-689(31x31)
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