型号 XC4VLX15-11SF363I 品牌XILINX
数据列表 Virtex-4 Family Overview;_
标准包装 90
包装 托盘
零件状态 在售
类别 集成电路（IC）
产品族 嵌入式 - FPGA（现场可编程门阵列）
系列 Virtex?-4 LX
规格
LAB/CLB 数 1536
逻辑元件/单元数 13824
总 RAM 位数 884736
I/O 数 240
电压 - 电源 1.14V ~ 1.26V
安装类型 表面贴装
工作温度 -40°C ~ 100°C（TJ）
封装/外壳 363-FBGA，FCBGA
供应商器件封装 363-FCBGA（17x17）
可编程逻辑解决方案厂商赛灵思公司(Xilinx， Inc.)日前宣布其DSP开发工具可将多速率DSP设计的Fmax性能提升高达38%，同时还大大提高了易用性。AccelDSP综合工具和System Generator for DSP工具9.2版的发布，使Xilinx XtremeDSP解决方案的开发工具组件提供了更高的性能水平，同时两种工具间的集成也更为紧密，为同时使用MATLAB和Simulink建模环境的开发人员进一步简化了FPGA设计流程。
对于无线和国防等典型多速率DSP设计开发人员来说，使用System Generator for DSP 9.2版本，在不对现有设计进行任何修改的情况下，能够提升Fmax性能高达38%。新版工具采用了一种新的映射算法，其中采用了寄存器复制技术，对于多速率设计中典型的大扇出网络采用了基于负载递归划分(recursive partitioning)的布局算法。这些增强的特性提高了易用性、提升了抽象层次，并大大改善了结果质量。对于那些越来越多地选择可编程逻辑作为硬件平台却不太熟悉FPGA的设计人员来说，这些优势正是他们所需要的。
赛灵思DSP设计环境
XtremeDSP设计环境用于在赛灵思FPGA中实现利用MATLAB和Simulink软件开发的DSP设计，主要由System Generator for DSP工具、AccelDSP综合工具以及丰富的DSP知识产权(IP)内核组成。与需要不同算法开发和RTL编码步骤的分立式设计流程不同，System Generator for DSP提供了一个综合的建模和验证环境，从在Simulink中完成最初的设计输入直至最终的FPGA设计收敛，整个流程非常平滑，不需要学习或使用传统的RTL设计方法。AccelDSP综合工具是一个基于MATLAB语言的高级工具，主要用于针对赛灵思FPGA的DSP模块设计，可将浮点至定点转换过程自动化、生成可综合的VHDL或Verilog代码，并为验证过程创建测试基准向量。设计人员可以从MATLAB算法生成定点Cordially，++模型或System Generator模块。
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