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Low Skew CMOS PLL Clock Driver

Low Skew CMOS PLL Clock Driver The MC88915 Clock Driver utilizes phase–locked loop technology to lock its low skew outputs’ frequency and phase onto an input reference clock. It is designed to provide clock distribution for high performance PC’s and workstations. Features •Five Output

Motorola

摩托罗拉

Low Skew CMOS PLL Clock Driver

Low Skew CMOS PLL Clock Driver The MC88915 Clock Driver utilizes phase–locked loop technology to lock its low skew outputs’ frequency and phase onto an input reference clock. It is designed to provide clock distribution for high performance PC’s and workstations. Features •Five Output

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更新时间:2025-8-7 19:19:01
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    https://hch01.114ic.com/

    2020-11-13
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    2019-9-24
  • ML4824CP1-功率因数校正和PWM组合控制器

    概述 该ML4824是一场权力校正因数控制器,交换式电源供应。功率因数校正(PFC)的允许小,成本更低的大电容的使用,降低电力线负载和压力的开关场效应管,并在电力供应,完全符合结果与IEC1000- 2 -3规范。包括该ML4824电路用于实现领先优势,平均目前,“助推”型功率因数校正和结尾边沿,脉冲宽度调制(PWM)。该器件有两种版本;的ML4824- 1(fPWM= fPFC)和ML4824- 2(fPWM=2 × fPFC)。增加一倍的PWM开关频率允许用户可以设计更小的输出组件,同时保持最佳的PFC的工作频率。一个过电压比较器关闭PFC部分中事件中的一个负载突然减少。

    2013-2-11
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    2012-11-27
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    2012-11-6