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256Kx36/512Kx18SynchronousFlow-ThruSRAMwithNoBLArchitecture

FunctionalDescription TheCY7C1355AandCY7C1357ASRAMsaredesignedtoeliminatedeadcycleswhentransitionsfromREADtoWRITEorviceversa.TheseSRAMsareoptimizedfor100percentbusutilizationandachievesZeroBusLatency(ZBL).Theyintegrate262,144×36and524,288×18SRAMcells,

CypressCypressSemiconductor

赛普拉斯赛普拉斯半导体公司

Cypress
更新时间:2025-6-24 20:00:01
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