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256Kx36/512Kx18PipelinedSRAMwithNoBL??Architecture

FunctionalDescription TheCY7C1354BV25andCY7C1356BV25are2.5V,256Kx36and512Kx18SynchronouspipelinedburstSRAMswithNoBusLatency™(NoBL)logic,respectively.Theyaredesignedtosupportunlimitedtrueback-to-backRead/Writeoperationswithnowaitstates.TheCY7C1354BV25andC

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赛普拉斯赛普拉斯半导体公司

Cypress
更新时间:2025-6-24 19:25:01
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