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CY7C1353-50AC

256Kx18 Flow-Through SRAM with NoBL Architecture

Functional Description The CY7C1353 is a 3.3V 256K by 18 Synchronous-Flow-Through Burst SRAM designed specifically to support unlimited true back-to-back Read/Write operations without the insertion of wait states. The CY7C1353 is equipped with the advanced No Bus Latency (NoBL) logic required to

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赛普拉斯赛普拉斯半导体公司

更新时间:2025-10-19 22:59:00
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