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256Kx18PipilinedSRAmwithNoBLArchitecture

FunctionalDescription TheCY7C1352Bisa3.3V256Kby18synchronous-pipelinedBurstSRAMdesignedspecificallytosupportunlimitedtrueback-to-backRead/Writeoperationswithouttheinsertionofwaitstates.TheCY7C1352BisequippedwiththeadvancedNoBusLatency™(NoBL™)logicrequiredto

CypressCypressSemiconductor

赛普拉斯赛普拉斯半导体公司

Cypress
更新时间:2025-6-24 11:38:01
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