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74HCT73

Dual JK flip-flop with reset; negative-edge trigger

General description The 74HC73 is a high-speed Si-gate CMOS device and is pin compatible with low-power Schottky TTL (LSTTL). The 74HC73 is specified in compliance with JEDEC standard no. 7A. Features Low-power dissipation Complies with JEDEC standard no. 7A ESD protection:

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Dual J-K Flip-Flop with Reset Negative-Edge Trigger

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Dual J-K Flip-Flop with Reset Negative-Edge Trigger

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更新时间:2026-8-1 22:50:00
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