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74ABT899D中文资料

厂家型号

74ABT899D

文件大小

123.08Kbytes

页面数量

16

功能描述

9-bit dual latch transceiver with 8-bit parity generator/checker 3-State

总线收发器 9-BIT LATCH XCVR W/PARITY 3-S

数据手册

原厂下载下载地址一下载地址二

生产厂商

PHI

74ABT899D数据手册规格书PDF详情

DESCRIPTION

The 74ABT899 is a 9-bit to 9-bit parity transceiver with separate transparent latches for the A bus and B bus. Either bus can generate or check parity.

FEATURES

• Symmetrical (A and B bus functions are identical)

• Selectable generate parity or ”feed-through” parity for A-to-B and

B-to-A directions

• Independent transparent latches for A-to-B and B-to-A directions

• Selectable ODD/EVEN parity

• Continuously checks parity of both A bus and B bus latches as

ERRA and ERRB

• Ability to simultaneously generate and check parity

• Can simultaneously read/latch A and B bus data

• Output capability: +64 mA/–32mA

• Latch-up protection exceeds 500mA per Jedec JC40.2 Std 17

• ESD protection exceeds 2000 V per MIL STD 883 Method 3015

and 200 V per Machine Model

• Power up 3-State

• Power-up reset

• Live insertion/extraction permitted

74ABT899D产品属性

  • 类型

    描述

  • 型号

    74ABT899D

  • 功能描述

    总线收发器 9-BIT LATCH XCVR W/PARITY 3-S

  • RoHS

  • 制造商

    Fairchild Semiconductor

  • 逻辑类型

    CMOS

  • 逻辑系列

    74VCX

  • 每芯片的通道数量

    16

  • 输入电平

    CMOS

  • 输出电平

    CMOS

  • 输出类型

    3-State

  • 高电平输出电流

    - 24 mA

  • 低电平输出电流

    24 mA

  • 传播延迟时间

    6.2 ns

  • 电源电压-最大

    2.7 V, 3.6 V

  • 电源电压-最小

    1.65 V, 2.3 V

  • 最大工作温度

    + 85 C

  • 封装/箱体

    TSSOP-48

  • 封装

    Reel

更新时间:2025-11-1 14:30:00
供应商 型号 品牌 批号 封装 库存 备注 价格
PHI
24+/25+
400
原装正品现货库存价优
PHI
24+
SOP
53
PHI
24+
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3500
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