型号 XC2VP30-5FGG676I 品牌XILINX
描述 价值
器件逻辑单元 30，816
设备逻辑单元 30，816
系统可编程性 是
铅整理 锡/银/铜
最大处理温度 250
最大用户I/O数 416
最大工作电压 1.575 V
最低工作电压 1.425 V
安装 表面安装
MSL电平 3
登记册数目 27，392
操作温度 0至85°C
针数 676
产品尺寸 27 x 27 x 1.73毫米
RAM位 2 506 752位
可重编程支持 1
筛选水平 商业
速度等级 5
供应商包装 FBGA
典型工作电压 1.5000 V
全新UltraScale架构中加入了哪些类似ASIC的功能？
UltraScale架构在完全可编程架构中应用尖端的ASIC技术，能从20nm平面FET扩展至16nm FinFET甚至更先进的技术，并可从单芯片电路扩展为3D IC。UltraScale架构不仅可以解决传统FPGA系统总吞吐量扩展和时延方面的局限性，而且还能直接突破高级节点上的头号系统性能瓶颈，即互连问题。它是如何实现的呢？
Xilinx公司全球高级副总裁汤立人：UltraScale架构中可提供类似ASIC的多区域时钟功能，这是一个重要改进。
首先，提供了类似ASIC的时钟功能。
UltraScale架构中可提供类似ASIC的多区域时钟功能，使得设计人员现在可以将系统级时钟放在整个晶片的任何最佳位置上，从而使系统级时钟歪斜降低多达50%。将时钟驱动的节点放在功能模块的几何中心并且平衡不同叶节点时钟单元(leaf clock cell)的时钟歪斜，这样可以打破阻碍实现多Gb系统级性能的一个最大瓶颈。UltraScale架构的类似ASIC时钟功能消除了时钟放置方面的一切限制并且能够在系统设计中实现大量独立的高性能低歪斜时钟资源，而这正是新一代设计的关键要求之一。这是与前几代可编程逻辑器件所采用的时钟方案的最大不同之处，而且实现了重大改进。
其次，提供了新一代路由：以应对大数据时代网络中心的海量数据流挑战。
对于海量数据流、多Gb智能包处理、多Tb吞吐量以及低时延方面的要求，互连问题已成为影响系统性能的头号瓶颈。
我们来做个类比。位于市中心的一个繁忙十字路口，交通流量的方向是从北到南，从南到北，从东到西，从西到东，有些车辆正试图掉头，所有交通车辆试图同时移动。这样通常就会造成大堵车。现在考虑一下将这一十字路口精心设计为现代化高速公路或主干道，情况又会如何。道路设计人员设计出了专用坡道（快行道），用以将交通流量从主要高速路口的一端顺畅地疏导至另一端。交通流量可以从高速路的一端全速移动到另一端，不存在堵车现象。下面的两幅图说明了这一观点：
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