| 型号 | 功能描述 | 生产厂家 企业 | LOGO | 操作 |
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Quad Analog-to-Digital Converter (ADC) FEATURES Four 4.5 V rms (typical) differential inputs On-chip phase-locked loop (PLL) for master clock Low electromagnetic interference (EMI) design 109 dB (typical) analog-to-digital converter (ADC) dynamic range Total harmonic distortion + noise (THD + N): −95 dB (typical) Selectable dig | AD 亚德诺 |   | ||
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Quad Analog-to-Digital Converter (ADC) 文件：1.69895 Mbytes Page：44 Pages | AD 亚德诺 | | ||
Quad Analog-to-Digital Converter (ADC) 文件：1.69895 Mbytes Page：44 Pages | AD 亚德诺 | |
更新时间：2025-12-25 13:36:01
| IC供应商 | 芯片型号 | 品牌 | 批号 | 封装 | 库存 | 备注 | 价格 |
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