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DDR I/DDR II Phase Lock Loop Zero Delay Buffer

Description Output Features DDR I/DDR II Zero Delay Clock Buffer • Low skew, low jitter PLL clock driver • Max frequency supported = 400MHz (DDRII 800) • I2C for functional and output control • Feedback pins for input to output synchronization • Spread Spectrum tolerant inputs • Programmab

RENESAS

瑞萨

DDR I/DDR II Phase Lock Loop Zero Delay Buffer

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IDT

DDR I/DDR II Phase Lock Loop Zero Delay Buffer

Description Output Features DDR I/DDR II Zero Delay Clock Buffer • Low skew, low jitter PLL clock driver • Max frequency supported = 400MHz (DDRII 800) • I2C for functional and output control • Feedback pins for input to output synchronization • Spread Spectrum tolerant inputs • Programmab

RENESAS

瑞萨

DDR I/DDR II Phase Lock Loop Zero Delay Buffer

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DDR I/DDR II Phase Lock Loop Zero Delay Buffer

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IDT

ICS9P935AFLF产品属性

  • 类型

    描述

  • 型号

    ICS9P935AFLF

  • 功能描述

    IC BUFFER DDR I/DDR2 PLL 28-SSOP

  • RoHS

  • 类别

    集成电路(IC) >> 时钟/计时 - 专用

  • 系列

    -

  • 标准包装

    28

  • 系列

    -

  • 类型

    时钟/频率发生器

  • PLL

  • 主要目的

    Intel CPU 服务器

  • 输入

    时钟

  • 输出

    LVCMOS

  • 电路数

    1 比率 -

  • 3

    22 差分 -

  • 输出

    无/是 频率 -

  • 最大

    400MHz

  • 电源电压

    3.135 V ~ 3.465 V

  • 工作温度

    0°C ~ 85°C

  • 安装类型

    表面贴装

  • 封装/外壳

    64-TFSOP(0.240,6.10mm 宽)

  • 供应商设备封装

    64-TSSOP

  • 包装

    管件

更新时间:2025-8-16 22:58:02
IC供应商 芯片型号 品牌 批号 封装 库存 备注 价格
ICS
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