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288M-BIT Low Latency DRAM Common I/O

Features • SRAM-type interface • Double-data-rate architecture • PLL circuitry • Cycle time: 2.5 ns @ tRC = 20 ns 3.3 ns @ tRC = 20 ns • Non-multiplexed addresses • Multiplexing option is available. • Data mask for WRITE commands • Differential input clocks (CK and CK#) • Differential in

RENESAS

瑞萨

更新时间:2025-10-30 23:00:01
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