| 型号 | 功能描述 | 生产厂家 企业 | LOGO | 操作 |
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ADS5474-SP | 14 位 400MSPS 模数转换器 (ADC) - V 类 ADS5474 是一款 14 位,400MSPS 模数转换器 (ADC),此转换器在提供 LVDS 兼容数字输出的同时,可由 5V 和 3V 电源供电运行。 这个 ADC 是 12,13,14 位 ADC 系列的一员,采样率在 210MSPS 至 500MSPS 之间。 ADS5474 输入缓冲器隔离了板上跟踪和保持 (T&H) 的内部开关,这样在提供一个高阻抗输入的同时,防止内部开关干扰信号源。 还提供了一个内部基准发生器来简化系统设计。在采样率为 400MSPS 时,针对超过 400MHz 的宽带宽信号的转换,设计使用 1.4GHz 输入带宽,ADS5474 在宽输入频率范围内具有出色低噪 • 400 MSPS 采样率\n• 1.28GHz 输入带宽\n• 230MHz 和 400MSPS 时,信噪比 (SNR) = 69.8dBFS\n• 兼容低压差分信令 (LVDS) 的输出\n• 断电模式:50mW\n• 半速率输出时钟上升沿和下降沿的输出数据变换\n• 采用 84 引脚陶瓷绝缘分流条封装 (HFG)\n• 可提供工程评估 (/EM) 样品 这些部件只用于工程评估。 它们的加工工艺为非兼容流程(例如,无预烧过程等)并且只在 25°C 的温度额定值下测试。 这些部件不适合于品质检定、生产、辐射测试或飞行使用。 不担保完全军用额定温度-55°C 至 125°C 范围内或使用; | TI 德州仪器 | ||
ADS5474-SP | Class V, 14-BIT, 400-MSPS ANALOG-TO-DIGITAL CONVERTER 文件:1.02087 Mbytes Page:28 Pages | TI 德州仪器 | ||
ADS5474-SP | Class V, 14-BIT, 400-MSPS ANALOG-TO-DIGITAL CONVERTER 文件:1.12459 Mbytes Page:29 Pages | TI 德州仪器 | ||
ADS5474-SP | 400MSPS ANALOG-TO-DIGITAL CONVERTER 文件:1.082 Mbytes Page:28 Pages | TI 德州仪器 | ||
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Dual Positive-Edge-Triggered D Flip-Flops with Preset, Clear and Complementary Outputs 文件:121.73 Kbytes Page:6 Pages | NSC 国半 | |||
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ADS5474-SP产品属性
- 类型
描述
- Resolution (Bits):
14
- Number of input channels:
1
- Interface type:
Parallel LVDS
- Analog input BW (MHz):
1440
- Features:
High Performance
- Rating:
Space
- Input range (Vp-p):
2.2
- Power consumption (Typ) (mW):
2500
- Architecture:
Pipeline
- SNR (dB):
70.5
- ENOB (Bits):
10.9
- SFDR (dB):
78
- Operating temperature range (C):
-55 to 125
- Input buffer:
Yes
| IC供应商 | 芯片型号 | 品牌 | 批号 | 封装 | 库存 | 备注 | 价格 |
|---|---|---|---|---|---|---|---|
ADI/亚德诺 |
MSOP10 |
6698 |
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TI/德州仪器 |
2450+ |
9850 |
只做原装正品 |
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NA |
26+ |
NA |
26094 |
10年以上分销经验原装进口正品,做服务型企业 |
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23+ |
CFP |
2000 |
进口原装现货假一罚十有挂就有货 |
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TI |
24+ |
SMD |
100 |
“芯达集团”专营军工百分之百原装进口 |
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3600 |
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1 |
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26+ |
BGA |
21530 |
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TI(德州仪器) |
2021+ |
8000 |
原装现货,欢迎询价 |
ADS5474-SP规格书下载地址
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2019-10-16ADS5400IPZP模数转换器全新原装深圳现货
特性 1-GSPS Sample Rate 12-Bit Resolution 2.1 GHz Input Bandwidth SFDR = 66 dBc at 1.2 GHz SNR = 57.6 dBFS at 1.2 GHz 7 Clock Cycle Latency Interleave Friendly: Internal Adjustments for Gain, Phase, and_Offset 1.5-V to 2-V Selectable Full-Scale Range LVDS-Compatible Outputs, 1 or 2 Bus
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2019-3-14
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