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64M bit Synchronous DRAM

DESCRIPTION The M2V64S20BTP is organized as 4-bank x 4194304-word x 4-bit, M2V64S30BTP is organized as 4-bank x 2097152-word x 8-bit, and M2V64S40BTP is organized as 4-bank x 1048576-word x 16-bit Synchronous DRAM with LVTTL interface. All inputs and outputs are referenced to the rising edge of C

Mitsubishi

三菱电机

64M bit Synchronous DRAM

DESCRIPTION M2V64S20BTP is organized as 4-bank x4,194,304-word x 4-bit,and M2V64S30BTP is organized as 4-bank x 2097152-word x 8-bit ,and M2V64S40BTP is organized as 4-bank x 1048576-word x 16-bit Synchronous DRAM with LVTTL interface. All inputs and outputs are referenced to the rising edge of C

Mitsubishi

三菱电机

更新时间:2025-8-10 1:37:01
IC供应商 芯片型号 品牌 批号 封装 库存 备注 价格
M
20+
QFP
500
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