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Low Cost DDR Phase Lock Loop Zero Delay Buffer

Product Description/Features: • Low skew, low jitter PLL clock driver • Max frequency supported = 266MHz (DDR 533) • I2C for functional and output control • Feedback pins for input to output synchronization • Spread Spectrum tolerant inputs • 3.3V tolerant CLK_INT/C input Recommended Applic

ICST

更新时间:2026-5-23 19:23:01
IC供应商 芯片型号 品牌 批号 封装 库存 备注 价格
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